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uvm验证及其进阶
第17任务： 讲解lab5，lab6
查看课程
任务列表
第1任务： UVM01- OOP overview
第2任务： UVM02_UVM_testbench
第3任务： UVM02_UVM_testbench2
第4任务： UVM02_UVM_testbench3
第5任务： Lab1 and DUT_Spec
第6任务： UVM_Transaction_Modeling
第7任务： UVM_04_Creating_stimulus_sequences
第8任务： UVM_Creating_stimulus_sequences——2
第9任务： UVM05_Component_configuration
第10任务： UVM05_factory
第11任务： TLM communication
第12任务： scoreboard and coverage
第13任务： UVM callback
第14任务： UVM Component phase
第15任务： lab2，3，4讲解
第16任务： virtual sequence and sequencer
第17任务： 讲解lab5，lab6
第18任务： Register Abstraction Layer
第19任务： Register Abstraction Layer 续
第20任务： lab7讲解和uvm review
第21任务： Sramc DUT讲解和规划sramc bench结构
第22任务： 调试默认bench
第23任务： drv等组件的开发
第24任务： sramc读写测试
第25任务： monitor和scoreboard的开发
第26任务： 课程总结和回顾
