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SystemVerilog精讲
第27任务： day5_lec2_assertion_sequence
查看课程
任务列表
第1任务： day1_lec1_verilog验证平台
第2任务： day1_lec2_verilog验证平台续及vnc演示
第3任务： day1_lec3_sv验证平台
第4任务： day1_lec4_验证计划
第5任务： day1_lec5_验证环境
第6任务： day1_lec6_dut_spec讲解
第7任务： day2_lec1_sv接口
第8任务： day2_lec2_timingblock等概念
第9任务： day2_lec3_sv数据类型part1
第10任务： day2_lec4_sv数据类型part2
第11任务： day2_lec5_sv数据类型part3
第12任务： day2_lec6_sv数据类型part4
第13任务： day2_lec7_sv_lab1讲解
第14任务： day3_lec1_sv过程语句
第15任务： day3_lec2_task和function
第16任务： day3_lec3_oop_part1
第17任务： day3_lec4_oop_part2
第18任务： day3_lec5_random_part1
第19任务： day3_lec6_random_part2
第20任务： day4_lec1_sv_thread
第21任务： day4_lec2_sv_内部通信机制
第22任务： day4_lec3_sv_event
第23任务： day4_lec4_sv_ipc
第24任务： day4_lec5_coverage_part1
第25任务： day4_lec6_coverage_part2
第26任务： day5_lec1_assrtion_summary
第27任务： day5_lec2_assertion_sequence
第28任务： day5_lec3_assertion_property
第29任务： svv lab2讲解
第30任务： svv lab3讲解
第31任务： svv_lab4讲解
第32任务： svv_lab5讲解
第33任务： SV考试
