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SystemVerilog设计技术
第1任务： 先导课
查看课程
任务列表
第1任务： 先导课
第2任务： 产业介绍
第3任务： 语言介绍
第4任务： 基础语法-1
第5任务： 基础语法-2
第6任务： 逻辑仿真-1
第7任务： 逻辑仿真-2
第8任务： 实训任务-数字逻辑仿真技术VCS_Lab- 问题版
第9任务： 结构级描述
第10任务： 操作符
第11任务： 行为级建模-1
第12任务： 行为级建模-2
第13任务： 任务和函数
第14任务： 状态机
第15任务： 延时建模-1
第16任务： 延时建模-2
第17任务： 单元库
第18任务： 文本操作
第19任务： 逻辑综合-1
第20任务： 逻辑综合-2
第21任务： 实训任务-逻辑综合工具DesignCompiler_Lab
第22-1任务： Sypglass介绍
第22-2任务： 10-01Spyglass CDC 入门手册
第23任务： 实训任务 Spyglass CDC 入门手册
第24任务： clock_gating
第25-1任务： 实训任务 Clock_Swith_Glitch_Free_Verdi调试方法和Makefile
第25-2任务： 10-02Clock_Swith_Glitch_Free_Verdi调试方法和Makefile
第26-1任务： 项目-有限状态机
第26-2任务： 11实训-有限状态机的设计与验证 - 答案版
第27任务： 实训任务 有限状态机的设计与验证 - 含答案
第28任务： 项目-层次设计
第29任务： 项目-接口
第30任务： 项目-ALU01
第31任务： 项目-ALU02
第32任务： 实训任务 ALU设计规格说明
